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@ -6,14 +6,14 @@
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*/
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#ifdef USE_CPLUSPLUS
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#include <string.h>
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#include <stdlib.h>
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#include "f4ll/packetusart.h"
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#include "f4ll/crchandler.h"
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#include "f4ll/memcpydma.h"
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#include "f4ll/consolehandler.h"
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#include "f4ll/crc_handler.h"
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#include "f4ll/irqlock.h"
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#include "f4ll/memcpydma.h"
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#include "f4ll/packetusart.h"
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#include "f4ll/strutil.h"
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#include <stdlib.h>
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#include <string.h>
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extern "C" {
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#include "main.h"
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@ -38,8 +38,8 @@ extern "C" void MainLoop()
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f4ll::MemcpyDma::Init(MEMCPY_DMA_ENGINE, MEMCPY_DMA_STREAM);
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f4ll::CrcHandler::Init(DMA2, LL_DMA_STREAM_4);
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||||
f4ll::ConsoleHandler::Init(UART4, CONSOLE_DMA_ENGINE, 0u, CONSOLE_TX_DMA_STREAM);
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||||
f4ll::crc_handler::Init(DMA2, LL_DMA_STREAM_4);
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||||
f4ll::ConsoleHandler::Init(UART4, CONSOLE_DMA_ENGINE, 0u, CONSOLE_TX_DMA_STREAM);
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||||
f4ll::PacketUsart u1{ USART1, DMA2, LL_DMA_STREAM_2, LL_DMA_STREAM_7 };
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f4ll::PacketUsart u2{ USART2, DMA1, LL_DMA_STREAM_5, LL_DMA_STREAM_6 };
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@ -1,4 +1,6 @@
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#include "f4ll/console_handler.h"
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#include <f4ll/console_handler.h>
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#include <f4ll/crc_handler.h>
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#include <f4ll/memcpy_dma.h>
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#include <config.h>
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#include <globals.h>
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@ -6,73 +8,80 @@
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void usart1_rx_dma_isr(void)
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{
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f4ll::PacketUsart::HandleRxDmaIrq(g_usarts[USART1_OFFSET]);
|
||||
f4ll::PacketUsart::rx_dma_isr(g_usarts[USART1_OFFSET]);
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||||
}
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||||
void usart1_tx_dma_isr(void)
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{
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||||
f4ll::PacketUsart::HandleTxDmaIrq(g_usarts[USART1_OFFSET]);
|
||||
f4ll::PacketUsart::tx_dma_isr(g_usarts[USART1_OFFSET]);
|
||||
}
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||||
void usart1_isr(void)
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||||
{
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||||
f4ll::PacketUsart::HandleUsartIrq(g_usarts[USART1_OFFSET]);
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||||
f4ll::PacketUsart::usart_isr(g_usarts[USART1_OFFSET]);
|
||||
}
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//
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void usart2_rx_dma_isr(void)
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{
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||||
f4ll::PacketUsart::HandleRxDmaIrq(g_usarts[USART2_OFFSET]);
|
||||
f4ll::PacketUsart::rx_dma_isr(g_usarts[USART2_OFFSET]);
|
||||
}
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||||
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||||
void usart2_tx_dma_isr(void)
|
||||
{
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||||
f4ll::PacketUsart::HandleTxDmaIrq(g_usarts[USART2_OFFSET]);
|
||||
f4ll::PacketUsart::tx_dma_isr(g_usarts[USART2_OFFSET]);
|
||||
}
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||||
void usart2_isr(void)
|
||||
{
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||||
f4ll::PacketUsart::HandleUsartIrq(g_usarts[USART2_OFFSET]);
|
||||
f4ll::PacketUsart::usart_isr(g_usarts[USART2_OFFSET]);
|
||||
}
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//
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||||
void usart3_rx_dma_isr(void)
|
||||
{
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||||
f4ll::PacketUsart::HandleRxDmaIrq(g_usarts[USART3_OFFSET]);
|
||||
f4ll::PacketUsart::rx_dma_isr(g_usarts[USART3_OFFSET]);
|
||||
}
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||||
|
||||
void usart3_tx_dma_isr(void)
|
||||
{
|
||||
f4ll::PacketUsart::HandleTxDmaIrq(g_usarts[USART3_OFFSET]);
|
||||
f4ll::PacketUsart::tx_dma_isr(g_usarts[USART3_OFFSET]);
|
||||
}
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||||
void usart3_isr(void)
|
||||
{
|
||||
f4ll::PacketUsart::HandleUsartIrq(g_usarts[USART3_OFFSET]);
|
||||
f4ll::PacketUsart::usart_isr(g_usarts[USART3_OFFSET]);
|
||||
}
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//
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void usart4_rx_dma_isr(void) {} // console
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void usart4_tx_dma_isr(void)
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{
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||||
f4ll::console_handler::HandleTxDmaIrq(&f4ll::console_handler::instance());
|
||||
f4ll::console_handler::tx_dma_isr(&f4ll::console_handler::instance());
|
||||
} // console
|
||||
void usart4_isr(void)
|
||||
{
|
||||
f4ll::console_handler::HandleUsartIrq(&f4ll::console_handler::instance());
|
||||
f4ll::console_handler::usart_isr(&f4ll::console_handler::instance());
|
||||
}
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||||
|
||||
//
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||||
void usart6_rx_dma_isr(void)
|
||||
{
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||||
f4ll::PacketUsart::HandleRxDmaIrq(g_usarts[USART6_OFFSET]);
|
||||
f4ll::PacketUsart::rx_dma_isr(g_usarts[USART6_OFFSET]);
|
||||
}
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||||
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||||
void usart6_tx_dma_isr(void)
|
||||
{
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||||
f4ll::PacketUsart::HandleTxDmaIrq(g_usarts[USART6_OFFSET]);
|
||||
f4ll::PacketUsart::tx_dma_isr(g_usarts[USART6_OFFSET]);
|
||||
}
|
||||
void usart6_isr(void)
|
||||
{
|
||||
f4ll::PacketUsart::HandleUsartIrq(g_usarts[USART6_OFFSET]);
|
||||
f4ll::PacketUsart::usart_isr(g_usarts[USART6_OFFSET]);
|
||||
}
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||||
void m2m1_dma_isr(void) {} // m2mcpy
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void m2m2_dma_isr(void) {} // crc
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void m2m1_dma_isr(void)
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{
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||||
f4ll::memcpy_dma::instance().dma_transfer_completed();
|
||||
} // m2mcpy
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||||
void m2m2_dma_isr(void)
|
||||
{
|
||||
f4ll::crc_handler::instance().dma_transfer_completed();
|
||||
} // crc
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||||
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